src/vendorcode/amd/agesa/f15/Proc/Mem/Ps/mpseeds.c

   1 /* $NoKeywords:$ */
   2 /**
   3  * @file
   4  *
   5  * mpseeds.c
   6  *
   7  * A sub-engine extracts WL and HW RxEn seeds from PSCFG tables.
   8  *
   9  * @xrefitem bom "File Content Label" "Release Content"
  10  * @e project: AGESA
  11  * @e sub-project: (Mem/Ps)
  12  * @e \$Revision: 45233 $ @e \$Date: 2011-01-13 21:58:29 -0600 (Thu, 13 Jan 2011) $
  13  *
  14  **/
  15 /*****************************************************************************
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  36 * (INCLUDING, BUT NOT LIMITED TO, PROCUREMENT OF SUBSTITUTE GOODS OR SERVICES;
  37 * LOSS OF USE, DATA, OR PROFITS; OR BUSINESS INTERRUPTION) HOWEVER CAUSED AND
  38 * ON ANY THEORY OF LIABILITY, WHETHER IN CONTRACT, STRICT LIABILITY, OR TORT
  39 * (INCLUDING NEGLIGENCE OR OTHERWISE) ARISING IN ANY WAY OUT OF THE USE OF THIS
  40 * SOFTWARE, EVEN IF ADVISED OF THE POSSIBILITY OF SUCH DAMAGE.
  41 *
  42 * ***************************************************************************
  43 *
  44 */
  45 /*
  46  *----------------------------------------------------------------------------
  47  *                                MODULES USED
  48  *
  49  *----------------------------------------------------------------------------
  50  */
  51
  52
  53
  54 #include "AGESA.h"
  55 #include "AdvancedApi.h"
  56 #include "amdlib.h"
  57 #include "Ids.h"
  58 #include "cpuFamRegisters.h"
  59 #include "cpuRegisters.h"
  60 #include "OptionMemory.h"
  61 #include "PlatformMemoryConfiguration.h"
  62 #include "mu.h"
  63 #include "ma.h"
  64 #include "mp.h"
  65 #include "merrhdl.h"
  66 #include "GeneralServices.h"
  67 #include "Filecode.h"
  68 CODE_GROUP (G2_PEI)
  69 RDATA_GROUP (G2_PEI)
  70
  71 #define FILECODE PROC_MEM_PS_MPSEEDS_FILECODE
  72
  73
  74 /*----------------------------------------------------------------------------
  75  *                          DEFINITIONS AND MACROS
  76  *
  77  *----------------------------------------------------------------------------
  78  */
  79
  80 /*----------------------------------------------------------------------------
  81  *                           TYPEDEFS AND STRUCTURES
  82  *
  83  *----------------------------------------------------------------------------
  84  */
  85 /*----------------------------------------------------------------------------
  86  *                        PROTOTYPES OF LOCAL FUNCTIONS
  87  *
  88  *----------------------------------------------------------------------------
  89  */
  90 BOOLEAN
  91 MemPGetTrainingSeeds (
  92   IN OUT   MEM_NB_BLOCK *NBPtr,
  93   IN       MEM_PSC_TABLE_BLOCK *EntryOfTables
  94   );
  95
  96 /*----------------------------------------------------------------------------
  97  *                            EXPORTED FUNCTIONS
  98  *
  99  *----------------------------------------------------------------------------
 100  */
 101 /* -----------------------------------------------------------------------------*/
 102 /**
 103  *
 104  *    A sub-function extracts WL and HW RxEn seeds from PSCFG tables
 105  *    from a input table
 106  *
 107  *     @param[in,out]   *NBPtr   - Pointer to the MEM_NB_BLOCK
 108  *     @param[in]       *EntryOfTables     - Pointer to MEM_PSC_TABLE_BLOCK
 109  *
 110  *     @return          NBPtr->PsPtr->WLSeedVal
 111  *     @return          NBPtr->PsPtr->HWRxENSeedVal
 112  *
 113  */
 114 BOOLEAN
 115 MemPGetTrainingSeeds (
 116   IN OUT   MEM_NB_BLOCK *NBPtr,
 117   IN       MEM_PSC_TABLE_BLOCK *EntryOfTables
 118   )
 119 {
 120
 121   UINT8 i;
 122   UINT8 MaxDimmPerCh;
 123   UINT8 NOD;
 124   UINT8 TableSize;
 125   DIMM_TYPE DimmType;
 126   CPU_LOGICAL_ID LogicalCpuid;
 127   UINT8 PackageType;
 128   UINT8 Seedloop;
 129   UINT8 CH;
 130   PSC_TBL_ENTRY **TblEntryPtr;
 131   PSCFG_SEED_ENTRY *TblPtr;
 132   CH_DEF_STRUCT *CurrentChannel;
 133
 134   CurrentChannel = NBPtr->ChannelPtr;
 135   TblEntryPtr = NULL;
 136   TblPtr = NULL;
 137   TableSize = 0;
 138   PackageType = 0;
 139   LogicalCpuid.Family = AMD_FAMILY_UNKNOWN;
 140   MaxDimmPerCh = GetMaxDimmsPerChannel (NBPtr->RefPtr->PlatformMemoryConfiguration, NBPtr->MCTPtr->SocketId, CurrentChannel->ChannelID);
 141   NOD = (UINT8) 1 << (MaxDimmPerCh - 1);
 142   CH = 1 << (CurrentChannel->ChannelID);
 143
 144   if (CurrentChannel->RegDimmPresent != 0) {
 145     DimmType = RDIMM_TYPE;
 146   } else if (CurrentChannel->SODimmPresent != 0) {
 147     DimmType = SODIMM_TYPE;
 148     if (FindPSOverrideEntry (NBPtr->RefPtr->PlatformMemoryConfiguration, PSO_SOLDERED_DOWN_SODIMM_TYPE, NBPtr->MCTPtr->SocketId, NBPtr->ChannelPtr->ChannelID, 0, NULL, NULL) != NULL) {
 149       DimmType = SODWN_SODIMM_TYPE;
 150     }
 151   } else if (CurrentChannel->LrDimmPresent != 0) {
 152     DimmType = LRDIMM_TYPE;
 153   } else {
 154     DimmType = UDIMM_TYPE;
 155   }
 156
 157   // Get seed value of WL, then HW RxEn
 158   for (Seedloop = 0; Seedloop < 2; Seedloop++) {
 159     TblEntryPtr = (Seedloop == 0) ? EntryOfTables->TblEntryOfWLSeed : EntryOfTables->TblEntryOfHWRxENSeed;
 160
 161     i = 0;
 162     // Obtain table pointer, table size, Logical Cpuid and PSC type according to Dimm, NB and package type.
 163     while (TblEntryPtr[i] != NULL) {
 164       if (((TblEntryPtr[i])->Header.DimmType & DimmType) != 0) {
 165         //
 166         // Determine if this is the expected NB Type
 167         //
 168         LogicalCpuid = (TblEntryPtr[i])->Header.LogicalCpuid;
 169         PackageType = (TblEntryPtr[i])->Header.PackageType;
 170         if (MemPIsIdSupported (NBPtr, LogicalCpuid, PackageType)) {
 171           TblPtr = (PSCFG_SEED_ENTRY *) ((TblEntryPtr[i])->TBLPtr);
 172           TableSize = (TblEntryPtr[i])->TableSize;
 173           break;
 174         }
 175       }
 176       i++;
 177     }
 178
 179     // Check whether no table entry is found.
 180     if (TblEntryPtr[i] == NULL) {
 181       IDS_HDT_CONSOLE (MEM_FLOW, "\nNo %s training seeds Config table\n", (Seedloop == 0) ? "WL" : "HW RxEn");
 182       return FALSE;
 183     }
 184
 185     for (i = 0; i < TableSize; i++) {
 186       if ((TblPtr->DimmPerCh & NOD) != 0) {
 187         if ((TblPtr->Channel & CH) != 0) {
 188           if (Seedloop == 0) {
 189             NBPtr->PsPtr->WLSeedVal = (UINT8) TblPtr->SeedVal;
 190           } else {
 191             NBPtr->PsPtr->HWRxENSeedVal = TblPtr->SeedVal;
 192           }
 193           break;
 194         }
 195       }
 196       TblPtr++;
 197     }
 198
 199     if (i == TableSize) {
 200       IDS_HDT_CONSOLE (MEM_FLOW, "\nNo %s seed entries\n\n", (Seedloop == 0) ? "WL" : "HW RxEn");
 201       PutEventLog (AGESA_ERROR, MEM_ERROR_TRAINING_SEED_NOT_FOUND, NBPtr->Node, NBPtr->Dct, NBPtr->Channel, 0, &NBPtr->MemPtr->StdHeader);
 202       SetMemError (AGESA_ERROR, NBPtr->MCTPtr);
 203       if (!NBPtr->MemPtr->ErrorHandling (NBPtr->MCTPtr, NBPtr->Dct, EXCLUDE_ALL_CHIPSEL, &NBPtr->MemPtr->StdHeader)) {
 204         ASSERT (FALSE);
 205       }
 206       return FALSE;
 207     }
 208   }
 209
 210   return TRUE;
 211 }