src/vendorcode/amd/agesa/f15/Proc/Mem/Ps/HY/mpuhy3.c

   1 /* $NoKeywords:$ */
   2 /**
   3  * @file
   4  *
   5  * mpuhy3.c
   6  *
   7  * Platform specific settings for HY DDR3 U-DIMM system
   8  *
   9  * @xrefitem bom "File Content Label" "Release Content"
  10  * @e project: AGESA
  11  * @e sub-project: (Mem/Ps)
  12  * @e \$Revision: 44324 $ @e \$Date: 2010-12-22 02:16:51 -0700 (Wed, 22 Dec 2010) $
  13  *
  14  **/
  15 /*****************************************************************************
  16   *
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  36  * (INCLUDING, BUT NOT LIMITED TO, PROCUREMENT OF SUBSTITUTE GOODS OR SERVICES;
  37  * LOSS OF USE, DATA, OR PROFITS; OR BUSINESS INTERRUPTION) HOWEVER CAUSED AND
  38  * ON ANY THEORY OF LIABILITY, WHETHER IN CONTRACT, STRICT LIABILITY, OR TORT
  39  * (INCLUDING NEGLIGENCE OR OTHERWISE) ARISING IN ANY WAY OUT OF THE USE OF THIS
  40  * SOFTWARE, EVEN IF ADVISED OF THE POSSIBILITY OF SUCH DAMAGE.
  41   *
  42   * ***************************************************************************
  43   *
  44  */
  45
  46 /* This file contains routine that add platform specific support L1 */
  47
  48
  49 #include "AGESA.h"
  50 #include "AdvancedApi.h"
  51 #include "PlatformMemoryConfiguration.h"
  52 #include "mport.h"
  53 #include "ma.h"
  54 #include "Ids.h"
  55 #include "cpuFamRegisters.h"
  56 #include "mm.h"
  57 #include "mn.h"
  58 #include "mp.h"
  59 #include "GeneralServices.h"
  60 #include "Filecode.h"
  61 CODE_GROUP (G2_PEI)
  62 RDATA_GROUP (G2_PEI)
  63
  64 #define FILECODE PROC_MEM_PS_HY_MPUHY3_FILECODE
  65 /*----------------------------------------------------------------------------
  66  *                          DEFINITIONS AND MACROS
  67  *
  68  *----------------------------------------------------------------------------
  69  */
  70
  71 /*----------------------------------------------------------------------------
  72  *                           TYPEDEFS AND STRUCTURES
  73  *
  74  *----------------------------------------------------------------------------
  75  */
  76
  77 /*----------------------------------------------------------------------------
  78  *                        PROTOTYPES OF LOCAL FUNCTIONS
  79  *
  80  *----------------------------------------------------------------------------
  81  */
  82 BOOLEAN
  83 STATIC
  84 MemPDoPsUhy3 (
  85   IN OUT   MEM_NB_BLOCK *NBPtr
  86   );
  87
  88 VOID
  89 STATIC
  90 MemPGetPORFreqLimitUHy3 (
  91   IN OUT   MEM_NB_BLOCK *NBPtr
  92   );
  93 /*
  94  *-----------------------------------------------------------------------------
  95  *                                EXPORTED FUNCTIONS
  96  *
  97  *-----------------------------------------------------------------------------
  98  */
  99 STATIC CONST DRAM_TERM_ENTRY HyUDdr3DramTerm[] = {
 100   {DDR800 + DDR1066 + DDR1333 + DDR1600, ONE_DIMM, NO_DIMM, 1, 0, 0},
 101   {DDR800 + DDR1066, TWO_DIMM, NO_DIMM, 3, 0, 2},
 102   {DDR1333, TWO_DIMM, NO_DIMM, 5, 0, 2},
 103   {DDR1600, TWO_DIMM, NO_DIMM, 5, 0, 1}
 104 };
 105
 106 /* -----------------------------------------------------------------------------*/
 107 /**
 108  *
 109  *     This function is the constructor for the platform specific settings for U-DDR3 HY DDR3
 110  *
 111  *     @param[in,out]   *MemPtr           Pointer to MEM_DATA_STRUCTURE
 112  *     @param[in,out]   *ChannelPtr       Pointer to CH_DEF_STRUCT
 113  *     @param[in,out]   *PsPtr       Pointer to MEM_PS_BLOCK
 114  *
 115  *     @return          AGESA_SUCCESS
 116  *
 117  */
 118
 119 AGESA_STATUS
 120 MemPConstructPsUHy3 (
 121   IN OUT   MEM_DATA_STRUCT *MemPtr,
 122   IN OUT   CH_DEF_STRUCT *ChannelPtr,
 123   IN OUT   MEM_PS_BLOCK *PsPtr
 124   )
 125 {
 126   ASSERT (MemPtr != 0);
 127   ASSERT (ChannelPtr != 0);
 128
 129   if ((ChannelPtr->MCTPtr->LogicalCpuid.Family & AMD_FAMILY_10_HY) == 0) {
 130     return AGESA_UNSUPPORTED;
 131   }
 132   if (ChannelPtr->TechType != DDR3_TECHNOLOGY) {
 133     return AGESA_UNSUPPORTED;
 134   }
 135   if ((ChannelPtr->RegDimmPresent != 0) || (ChannelPtr->SODimmPresent != 0)) {
 136     return AGESA_UNSUPPORTED;
 137   }
 138   PsPtr->MemPDoPs = MemPDoPsUhy3;
 139   PsPtr->MemPGetPORFreqLimit = MemPGetPORFreqLimitUHy3;
 140   return AGESA_SUCCESS;
 141 }
 142
 143 /* -----------------------------------------------------------------------------*/
 144 /**
 145  *
 146  *     This is function sets the platform specific settings for U-DDR3 HY DDR3
 147  *
 148  *     @param[in,out]   *NBPtr           Pointer to MEM_NB_BLOCK
 149  *
 150  *     @return          TRUE - Find settings for corresponding platform and dimm population.
 151  *     @return          FALSE - Fail to find settings for corresponding platform and dimm population.
 152  *
 153  */
 154
 155 BOOLEAN
 156 STATIC
 157 MemPDoPsUhy3 (
 158   IN OUT   MEM_NB_BLOCK *NBPtr
 159   )
 160 {
 161   if (!MemPGetDramTerm (NBPtr, GET_SIZE_OF (HyUDdr3DramTerm), HyUDdr3DramTerm)) {
 162     return FALSE;
 163   }
 164
 165   return TRUE;
 166 }
 167
 168 /* -----------------------------------------------------------------------------*/
 169 /**
 170  *
 171  *     This is function gets the POR speed limit for U-DDR3 HY
 172  *
 173  *     @param[in,out]   *NBPtr           Pointer to MEM_NB_BLOCK
 174  *
 175  *
 176  */
 177 VOID
 178 STATIC
 179 MemPGetPORFreqLimitUHy3 (
 180   IN OUT   MEM_NB_BLOCK *NBPtr
 181   )
 182 {
 183   UINT16  MaxSpeed;
 184   //
 185   // Highest POR supported speed for Unbuffered dimm is 1333
 186   //
 187   MaxSpeed = DDR1333_FREQUENCY;
 188   if (NBPtr->DCTPtr->Timings.TargetSpeed > MaxSpeed) {
 189     NBPtr->DCTPtr->Timings.TargetSpeed = MaxSpeed;
 190   } else if (NBPtr->DCTPtr->Timings.TargetSpeed == DDR667_FREQUENCY) {
 191     // Unbuffered DDR3 at 333MHz is not supported
 192     NBPtr->DCTPtr->Timings.DimmExclude |= NBPtr->DCTPtr->Timings.DctDimmValid;
 193     PutEventLog (AGESA_ERROR, MEM_ERROR_UNSUPPORTED_333MHZ_UDIMM, NBPtr->Node, NBPtr->Dct, NBPtr->Channel, 0, &NBPtr->MemPtr->StdHeader);
 194     SetMemError (AGESA_ERROR, NBPtr->MCTPtr);
 195     // Change target speed to highest value so it won't affect other channels when leveling frequency across the node.
 196     NBPtr->DCTPtr->Timings.TargetSpeed = UNSUPPORTED_DDR_FREQUENCY;
 197   }
 198 }