src/vendorcode/amd/agesa/f15/Proc/Mem/NB/C32/mnS3c32.h

   1 /* $NoKeywords:$ */
   2 /**
   3  * @file
   4  *
   5  * mnS3c32.h
   6  *
   7  * S3 resume memory related function for C32.
   8  *
   9  * @xrefitem bom "File Content Label" "Release Content"
  10  * @e project: AGESA
  11  * @e sub-project: (Mem/NB/C32)
  12  * @e \$Revision: 44324 $ @e \$Date: 2010-12-22 02:16:51 -0700 (Wed, 22 Dec 2010) $
  13  *
  14  **/
  15 /*****************************************************************************
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  37 * LOSS OF USE, DATA, OR PROFITS; OR BUSINESS INTERRUPTION) HOWEVER CAUSED AND
  38 * ON ANY THEORY OF LIABILITY, WHETHER IN CONTRACT, STRICT LIABILITY, OR TORT
  39 * (INCLUDING NEGLIGENCE OR OTHERWISE) ARISING IN ANY WAY OUT OF THE USE OF THIS
  40 * SOFTWARE, EVEN IF ADVISED OF THE POSSIBILITY OF SUCH DAMAGE.
  41 *
  42 * ***************************************************************************
  43 *
  44 */
  45
  46 #ifndef _MNS3C32_H_
  47 #define _MNS3C32_H_
  48
  49 /*----------------------------------------------------------------------------
  50  *   Mixed (DEFINITIONS AND MACROS / TYPEDEFS, STRUCTURES, ENUMS)
  51  *
  52  *----------------------------------------------------------------------------
  53  */
  54 /// ID for register list of C32
  55 typedef enum {
  56   PCI_LST_ESR_C32,  ///< Assign 0x0000 for PCI register list for pre exit self refresh.
  57   PCI_LST_C32,      ///< Assign 0x0001 for PCI register list for post exist self refresh.
  58   CPCI_LST_ESR_C32, ///< Assign 0x0002 for conditional PCI register list for pre exit self refresh.
  59   CPCI_LST_C32,     ///< Assign 0x0003 for conditional PCI register list for post exit self refresh.
  60   MSR_LST_ESR_C32,  ///< Assign 0x0004 for MSR register list for pre exit self refresh.
  61   MSR_LST_C32,      ///< Assign 0x0005 for MSR register list for post exit self refresh.
  62   CMSR_LST_ESR_C32, ///< Assign 0x0006 for conditional MSR register list for pre exit self refresh.
  63   CMSR_LST_C32      ///< Assign 0x0007 for conditional MSR register list for post exit self refresh.
  64 } RegisterListIDC32;
  65
  66 /*-----------------------------------------------------------------------------
  67  *                         DEFINITIONS AND MACROS
  68  *
  69  *-----------------------------------------------------------------------------
  70  */
  71
  72 /*----------------------------------------------------------------------------
  73  *                         TYPEDEFS, STRUCTURES, ENUMS
  74  *
  75  *----------------------------------------------------------------------------
  76  */
  77
  78 /*----------------------------------------------------------------------------
  79  *                           FUNCTIONS PROTOTYPE
  80  *
  81  *----------------------------------------------------------------------------
  82  */
  83
  84 #endif //_MNS3C32_H_