src/mainboard/supermicro/h8dme/Options.lb

   1 ##
   2 ## This file is part of the coreboot project.
   3 ##
   4 ## Copyright (C) 2007 AMD
   5 ## Written by Yinghai Lu <yinghailu@amd.com> for AMD.
   6 ##
   7 ## This program is free software; you can redistribute it and/or modify
   8 ## it under the terms of the GNU General Public License as published by
   9 ## the Free Software Foundation; either version 2 of the License, or
  10 ## (at your option) any later version.
  11 ##
  12 ## This program is distributed in the hope that it will be useful,
  13 ## but WITHOUT ANY WARRANTY; without even the implied warranty of
  14 ## MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
  15 ## GNU General Public License for more details.
  16 ##
  17 ## You should have received a copy of the GNU General Public License
  18 ## along with this program; if not, write to the Free Software
  19 ## Foundation, Inc., 51 Franklin St, Fifth Floor, Boston, MA  02110-1301 USA
  20 ##
  21
  22 uses CONFIG_HAVE_MP_TABLE
  23 uses CONFIG_CBFS
  24 uses CONFIG_HAVE_PIRQ_TABLE
  25 uses CONFIG_HAVE_ACPI_TABLES
  26 uses CONFIG_HAVE_ACPI_RESUME
  27 uses CONFIG_ACPI_SSDTX_NUM
  28 uses CONFIG_USE_FALLBACK_IMAGE
  29 uses CONFIG_USE_FAILOVER_IMAGE
  30 uses CONFIG_HAVE_FALLBACK_BOOT
  31 uses CONFIG_HAVE_FAILOVER_BOOT
  32 uses CONFIG_HAVE_HARD_RESET
  33 uses CONFIG_IRQ_SLOT_COUNT
  34 uses CONFIG_HAVE_OPTION_TABLE
  35 uses CONFIG_MAX_CPUS
  36 uses CONFIG_MAX_PHYSICAL_CPUS
  37 uses CONFIG_LOGICAL_CPUS
  38 uses CONFIG_IOAPIC
  39 uses CONFIG_SMP
  40 uses CONFIG_FALLBACK_SIZE
  41 uses CONFIG_FAILOVER_SIZE
  42 uses CONFIG_ROM_SIZE
  43 uses CONFIG_ROM_SECTION_SIZE
  44 uses CONFIG_ROM_IMAGE_SIZE
  45 uses CONFIG_ROM_SECTION_SIZE
  46 uses CONFIG_ROM_SECTION_OFFSET
  47 uses CONFIG_ROM_PAYLOAD
  48 uses CONFIG_ROM_PAYLOAD_START
  49 uses CONFIG_COMPRESSED_PAYLOAD_NRV2B
  50 uses CONFIG_COMPRESSED_PAYLOAD_LZMA
  51 uses CONFIG_PRECOMPRESSED_PAYLOAD
  52 uses CONFIG_PAYLOAD_SIZE
  53 uses CONFIG_ROMBASE
  54 uses CONFIG_XIP_ROM_SIZE
  55 uses CONFIG_XIP_ROM_BASE
  56 uses CONFIG_STACK_SIZE
  57 uses CONFIG_HEAP_SIZE
  58 uses CONFIG_USE_OPTION_TABLE
  59 uses CONFIG_HAVE_LOW_TABLES
  60 uses CONFIG_MULTIBOOT
  61 uses CONFIG_LB_CKS_RANGE_START
  62 uses CONFIG_LB_CKS_RANGE_END
  63 uses CONFIG_LB_CKS_LOC
  64 uses CONFIG_MAINBOARD_PART_NUMBER
  65 uses CONFIG_MAINBOARD_VENDOR
  66 uses CONFIG_MAINBOARD
  67 uses CONFIG_MAINBOARD_PCI_SUBSYSTEM_VENDOR_ID
  68 uses CONFIG_MAINBOARD_PCI_SUBSYSTEM_DEVICE_ID
  69 uses COREBOOT_EXTRA_VERSION
  70 uses CONFIG_RAMBASE
  71 uses CONFIG_TTYS0_BAUD
  72 uses CONFIG_TTYS0_BASE
  73 uses CONFIG_TTYS0_LCS
  74 uses CONFIG_DEFAULT_CONSOLE_LOGLEVEL
  75 uses CONFIG_MAXIMUM_CONSOLE_LOGLEVEL
  76 uses CONFIG_MAINBOARD_POWER_ON_AFTER_POWER_FAIL
  77 uses CONFIG_CONSOLE_SERIAL8250
  78 uses CONFIG_HAVE_INIT_TIMER
  79 uses CONFIG_GDB_STUB
  80 uses CONFIG_GDB_STUB
  81 uses CONFIG_CROSS_COMPILE
  82 uses CC
  83 uses CONFIG_HOSTCC
  84 uses CONFIG_OBJCOPY
  85 uses CONFIG_CONSOLE_VGA
  86 uses CONFIG_PCI_ROM_RUN
  87 uses CONFIG_HW_MEM_HOLE_SIZEK
  88 uses CONFIG_HW_MEM_HOLE_SIZE_AUTO_INC
  89 uses CONFIG_K8_HT_FREQ_1G_SUPPORT
  90
  91 uses CONFIG_HT_CHAIN_UNITID_BASE
  92 uses CONFIG_HT_CHAIN_END_UNITID_BASE
  93 uses CONFIG_SB_HT_CHAIN_ON_BUS0
  94 uses CONFIG_SB_HT_CHAIN_UNITID_OFFSET_ONLY
  95
  96 uses CONFIG_USE_DCACHE_RAM
  97 uses CONFIG_DCACHE_RAM_BASE
  98 uses CONFIG_DCACHE_RAM_SIZE
  99 uses CONFIG_DCACHE_RAM_GLOBAL_VAR_SIZE
 100 uses CONFIG_USE_INIT
 101
 102 uses CONFIG_SERIAL_CPU_INIT
 103
 104 uses CONFIG_ENABLE_APIC_EXT_ID
 105 uses CONFIG_APIC_ID_OFFSET
 106 uses CONFIG_LIFT_BSP_APIC_ID
 107
 108 uses CONFIG_PCI_64BIT_PREF_MEM
 109
 110 uses CONFIG_LB_MEM_TOPK
 111
 112 uses CONFIG_AP_CODE_IN_CAR
 113
 114 uses CONFIG_MEM_TRAIN_SEQ
 115
 116 uses CONFIG_WAIT_BEFORE_CPUS_INIT
 117
 118 uses CONFIG_USE_PRINTK_IN_CAR
 119
 120 ###
 121 ### Build options
 122 ###
 123
 124 ##
 125 ## CONFIG_ROM_SIZE is the size of boot ROM that this board will use.
 126 ##
 127 #default CONFIG_ROM_SIZE=524288
 128 default CONFIG_ROM_SIZE=0x100000
 129
 130 default CONFIG_HAVE_LOW_TABLES = 0
 131 default CONFIG_MULTIBOOT=0
 132
 133 ##
 134 ## CONFIG_FALLBACK_SIZE is the amount of the ROM the complete fallback image will use
 135 ##
 136 #default CONFIG_FALLBACK_SIZE=131072
 137 #default CONFIG_FALLBACK_SIZE=0x40000
 138
 139 #FALLBACK: 256K-4K
 140 default CONFIG_FALLBACK_SIZE=0x3f000
 141 #FAILOVER: 4K
 142 default CONFIG_FAILOVER_SIZE=0x01000
 143
 144 #more 1M for pgtbl
 145 default CONFIG_LB_MEM_TOPK=2048
 146
 147 ##
 148 ## Build code for the fallback boot
 149 ##
 150 default CONFIG_HAVE_FALLBACK_BOOT=1
 151 default CONFIG_HAVE_FAILOVER_BOOT=1
 152
 153 ##
 154 ## Build code to reset the motherboard from coreboot
 155 ##
 156 default CONFIG_HAVE_HARD_RESET=1
 157
 158 ##
 159 ## Build code to export a programmable irq routing table
 160 ##
 161 default CONFIG_HAVE_PIRQ_TABLE=1
 162 default CONFIG_IRQ_SLOT_COUNT=11
 163
 164 ##
 165 ## Build code to export an x86 MP table
 166 ## Useful for specifying IRQ routing values
 167 ##
 168 default CONFIG_HAVE_MP_TABLE=1
 169
 170 ## ACPI tables will be included
 171 default CONFIG_HAVE_ACPI_TABLES=0
 172
 173 ##
 174 ## Build code to export a CMOS option table
 175 ##
 176 default CONFIG_HAVE_OPTION_TABLE=1
 177
 178 ##
 179 ## Move the default coreboot cmos range off of AMD RTC registers
 180 ##
 181 default CONFIG_LB_CKS_RANGE_START=49
 182 default CONFIG_LB_CKS_RANGE_END=122
 183 default CONFIG_LB_CKS_LOC=123
 184
 185 ##
 186 ## Build code for SMP support
 187 ## Only worry about 2 micro processors
 188 ##
 189 default CONFIG_SMP=1
 190 default CONFIG_MAX_CPUS=4
 191 default CONFIG_MAX_PHYSICAL_CPUS=2
 192 default CONFIG_LOGICAL_CPUS=1
 193
 194 default CONFIG_SERIAL_CPU_INIT=0
 195
 196 default CONFIG_ENABLE_APIC_EXT_ID=0
 197 default CONFIG_APIC_ID_OFFSET=0x10
 198 default CONFIG_LIFT_BSP_APIC_ID=1
 199
 200 #memory hole size, 0 mean disable, others will enable the hole, at that case if it is small than mmio_basek, it will use mmio_basek instead.
 201 #2G
 202 #default CONFIG_HW_MEM_HOLE_SIZEK=0x200000
 203 #1G
 204 default CONFIG_HW_MEM_HOLE_SIZEK=0x100000
 205 #512M
 206 #default CONFIG_HW_MEM_HOLE_SIZEK=0x80000
 207
 208 #make auto increase hole size to avoid hole_startk equal to basek so as to make some kernel happy
 209 #default CONFIG_HW_MEM_HOLE_SIZE_AUTO_INC=1
 210
 211 #Opteron K8 1G HT Support
 212 default CONFIG_K8_HT_FREQ_1G_SUPPORT=1
 213
 214 #VGA Console
 215 default CONFIG_CONSOLE_VGA=1
 216 default CONFIG_PCI_ROM_RUN=1
 217
 218 #HT Unit ID offset, default is 1, the typical one, 0 mean only one HT device
 219 default CONFIG_HT_CHAIN_UNITID_BASE=0
 220
 221 #real SB Unit ID, default is 0x20, mean dont touch it at last
 222 #default CONFIG_HT_CHAIN_END_UNITID_BASE=0x6
 223
 224 #make the SB HT chain on bus 0, default is not (0)
 225 default CONFIG_SB_HT_CHAIN_ON_BUS0=2
 226
 227 #only offset for SB chain?, default is yes(1)
 228 default CONFIG_SB_HT_CHAIN_UNITID_OFFSET_ONLY=0
 229
 230 #allow capable device use that above 4G
 231 #default CONFIG_PCI_64BIT_PREF_MEM=1
 232
 233 ##
 234 ## enable CACHE_AS_RAM specifics
 235 ##
 236 default CONFIG_USE_DCACHE_RAM=1
 237 default CONFIG_DCACHE_RAM_BASE=0xc8000
 238 default CONFIG_DCACHE_RAM_SIZE=0x08000
 239 default CONFIG_DCACHE_RAM_GLOBAL_VAR_SIZE=0x01000
 240 default CONFIG_USE_INIT=0
 241
 242 default CONFIG_AP_CODE_IN_CAR=1
 243 default CONFIG_MEM_TRAIN_SEQ=1
 244 default CONFIG_WAIT_BEFORE_CPUS_INIT=1
 245
 246 ##
 247 ## Build code to setup a generic IOAPIC
 248 ##
 249 default CONFIG_IOAPIC=1
 250
 251 ##
 252 ## Clean up the motherboard id strings
 253 ##
 254 default CONFIG_MAINBOARD_PART_NUMBER="h8dme"
 255 default CONFIG_MAINBOARD_VENDOR="Supermicro"
 256 default CONFIG_MAINBOARD_PCI_SUBSYSTEM_VENDOR_ID=0x15d9
 257 default CONFIG_MAINBOARD_PCI_SUBSYSTEM_DEVICE_ID=0x1511
 258
 259 ###
 260 ### coreboot layout values
 261 ###
 262
 263 ## CONFIG_ROM_IMAGE_SIZE is the amount of space to allow coreboot to occupy.
 264 default CONFIG_ROM_IMAGE_SIZE = 65536
 265
 266 ##
 267 ## Use a small 8K stack
 268 ##
 269 default CONFIG_STACK_SIZE=0x2000
 270
 271 ##
 272 ## Use a small 32K heap
 273 ##
 274 default CONFIG_HEAP_SIZE=0x8000
 275
 276 ##
 277 ## Only use the option table in a normal image
 278 ##
 279 default CONFIG_USE_OPTION_TABLE = (!CONFIG_USE_FALLBACK_IMAGE) && (!CONFIG_USE_FAILOVER_IMAGE )
 280
 281 ##
 282 ## Coreboot C code runs at this location in RAM
 283 ##
 284 default CONFIG_RAMBASE=0x00100000
 285
 286 ##
 287 ## Load the payload from the ROM
 288 ##
 289 default CONFIG_ROM_PAYLOAD = 1
 290
 291 #default CONFIG_COMPRESSED_PAYLOAD = 1
 292
 293 ###
 294 ### Defaults of options that you may want to override in the target config file
 295 ###
 296
 297 ##
 298 ## The default compiler
 299 ##
 300 default CC="$(CONFIG_CROSS_COMPILE)gcc -m32"
 301 default CONFIG_HOSTCC="gcc"
 302
 303 ##
 304 ## Disable the gdb stub by default
 305 ##
 306 default CONFIG_GDB_STUB=0
 307
 308 ##
 309 ## The Serial Console
 310 ##
 311 default CONFIG_USE_PRINTK_IN_CAR=1
 312
 313 # To Enable the Serial Console
 314 default CONFIG_CONSOLE_SERIAL8250=1
 315
 316 ## Select the serial console baud rate
 317 default CONFIG_TTYS0_BAUD=115200
 318 #default CONFIG_TTYS0_BAUD=57600
 319 #default CONFIG_TTYS0_BAUD=38400
 320 #default CONFIG_TTYS0_BAUD=19200
 321 #default CONFIG_TTYS0_BAUD=9600
 322 #default CONFIG_TTYS0_BAUD=4800
 323 #default CONFIG_TTYS0_BAUD=2400
 324 #default CONFIG_TTYS0_BAUD=1200
 325
 326 # Select the serial console base port
 327 default CONFIG_TTYS0_BASE=0x3f8
 328
 329 # Select the serial protocol
 330 # This defaults to 8 data bits, 1 stop bit, and no parity
 331 default CONFIG_TTYS0_LCS=0x3
 332
 333 ##
 334 ### Select the coreboot loglevel
 335 ##
 336 ## EMERG      1   system is unusable
 337 ## ALERT      2   action must be taken immediately
 338 ## CRIT       3   critical conditions
 339 ## ERR        4   error conditions
 340 ## WARNING    5   warning conditions
 341 ## NOTICE     6   normal but significant condition
 342 ## INFO       7   informational
 343 ## CONFIG_DEBUG      8   debug-level messages
 344 ## SPEW       9   Way too many details
 345
 346 ## Request this level of debugging output
 347 default  CONFIG_DEFAULT_CONSOLE_LOGLEVEL=9
 348 ## At a maximum only compile in this level of debugging
 349 default  CONFIG_MAXIMUM_CONSOLE_LOGLEVEL=9
 350
 351 ##
 352 ## Select power on after power fail setting
 353 default CONFIG_MAINBOARD_POWER_ON_AFTER_POWER_FAIL="MAINBOARD_POWER_ON"
 354
 355 ### End Options.lb
 356 #
 357 # CBFS
 358 #
 359 #
 360 default CONFIG_CBFS=0
 361 end